FPGA/CPLD 数位电路设计入门与实务应用:使用QuartusⅡ(第五版)(附系统.范例光碟) pdf epub mobi txt 电子书 下载 2024
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出版者 出版社:全华图书 订阅出版社新书快讯 新功能介绍
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出版日期 出版日期:2015/04/07
语言 语言:繁体中文
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发表于2024-11-30
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图书描述
本书是一本简单、易懂的数位电路设计及应用。书中软体是以QuartusII5.1版做为开发平台并运用到数位电路设计。将理论数位电路与现今的FPGA/CPLD,透过电脑辅助设计工具相结合,使读者可以应用各种编辑技术设计晶片外,更让读者了解如何将FPGA/CPLD应用在电子游戏领域之晶片上。本书共有七章:包括QuartusII软体安装及设计简介、算术逻辑电路设计、组合逻辑电路设计、计数器及除频器设计、综合练习设计、综合应用专题以及具有Audio音效乒乓球游戏实作等介绍。适用于大学、科大电子、电机、资工系「数位电路设计」、「数位系统设计」课程使用。
本书特色
1.本书可使读者了解如何使用(1)AHDL以及VHDL硬体描述语言(2)VerilogHDL硬体描述语言的方式设计FPGA/CPLD数位晶片。
2.教导读者知道应用各种编辑技术设计晶片,也让读者了解如何将FPGA/CPLD应用在电子游戏领域之晶片设计上。
3.此书详细说明QuartusⅡ软体操作方法与电路设计方式。
著者信息
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图书目录
第1章 QuartusII软体安装及设计流程简介
1.1 QuartusII软体安装 1-1
1.2 QuartusII软体介绍 1-11
1.3 QuartusII软体基本功能介绍 1-13
1.3.1 电路图编辑(Schematic Editor) 1-13
1.3.2 文字编辑(Text Editor) 1-14
1.3.3 专案编译(Compiler) 1-15
1.3.4 波形编辑(Waveform Editor) 1-15
1.3.5 波形模拟(Waveform Simulator) 1-16
1.3.6 接脚编辑(Pin Assignment Editor) 1-16
1.3.7 烧录(Programmer) 1-17
1.3.8 专案内次模组(Sub-Module)之个别编译 1-17
1.4 硬体描述语言(HDL)介绍 1-20
1.4.1 程式架构 1-20
1.4.2 运算操作与层次化设计的使用 1-25
第2章 算术逻辑电路设计
2.1 半加器(Half Adder) 2-1
2.1.1 电路图编辑半加器 2-2
2.1.2 AHDL编辑半加器 2-10
2.1.3 VHDL编辑半加器 2-12
2.1.4 模拟半加器 2-16
2.2 全加器(Full Adder) 2-21
2.2.1 电路图编辑全加器 2-21
2.2.2 AHDL编辑全加器 2-24
2.2.3 VHDL编辑全加器 2-26
2.2.4 模拟全加器 2-27
2.3 四位元加法器(4 Bits Adder) 2-29
2.3.1 电路图编辑四位元加法器 2-30
2.3.2 AHDL编辑四位元加法器 2-34
2.3.3 VHDL编辑四位元加法器 2-36
2.3.4 模拟四位元加法器 2-38
2.4 四位元乘法器 2-39
2.4.1 电路图编辑四位元乘法器 2-41
2.4.2 AHDL编辑四位元乘法器 2-45
2.4.3 使用MegaWizard建立四位元乘法器 2-47
2.4.4 VHDL编辑四位元乘法器 2-53
2.4.5 模拟四位元乘法器 2-55
第3章 组合逻辑电路设计
3.1 4对1多工器(4 to 1 Multiplexer) 3-1
3.1.1 使用MegaWizard建立4对1多工器 3-2
3.1.2 电路图编辑4对1多工器 3-7
3.1.3 AHDL编辑4对1多工器 3-9
3.1.4 VHDL编辑4对1多工器 3-11
3.1.5 模拟4对1多工器 3-13
3.2 1对4解多工器(1 to 4 Demultiplexer) 3-15
3.2.1 电路图编辑1对4解多工器 3-16
3.2.2 AHDL编辑1对4解多工器 3-19
3.2.3 VHDL编辑1对4解多工器 3-21
3.2.4 模拟1对4解多工器 3-22
3.3 七段显示器构造 3-24
3.3.1 AHDL编辑七段显示解码器 3-26
3.3.2 VHDL编辑七段显示解码器 3-29
3.3.3 模拟七段显示解码器 3-31
第4章 计数器及除频器设计
4.1 10模计数器设计 4-1
4.1.1 AHDL编辑10模计数器 4-2
4.1.2 VHDL编辑10模计数器 4-4
4.1.3 模拟10模计数器 4-9
4.2 60模计数器设计 4-11
4.2.1 AHDL编辑60模计数器 4-11
4.2.2 VHDL编辑60模计数器 4-14
4.2.3 模拟60模计数器 4-20
4.3 24模计数器设计 4-22
4.3.1 AHDL编辑24模计数器 4-22
4.3.2 VHDL编辑24模计数器 4-25
4.3.3 模拟24模计数器 4-31
4.4 除频器设计 4-32
4.4.1 AHDL编辑除100之除频器 4-33
4.4.2 VHDL编辑除100之除频器 4-35
图书序言
图书试读
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